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隐藏置顶帖金牌服务---Matlab编程服务（毕设、课设、作业、文章复现等）	admin 2023-7-22	0178769	admin 2024-10-31 23:11
隐藏置顶帖必过源码会员保障	admin 2024-8-7	0109520	admin 2024-8-7 16:17
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基于Xilinx FPGA实现的系数可装载数字滤波器源代码	admin 2025-4-4	0227	admin 2025-4-4 14:21
基于Xilinx FPGA实现的系数可装载数字滤波器源代码	admin 2025-4-2	0239	admin 2025-4-2 01:17
FPGA端口电平配置的工程文件，可以实现不同的端口配置，包括PECL,TTL,LVDS等，关键是	admin 2024-12-26	01532	admin 2024-12-26 02:18
Vivado初始化和配置，并且还包含有相应的说明文档，是初学Xilinx+Vivado的很好的教程	admin 2024-12-26	01424	admin 2024-12-26 02:16
LVDS的FPGA实现，包括ISE工程和源码，还有一个PDF演示文档	admin 2024-12-26	01304	admin 2024-12-26 02:06
Verilog中基于FPGA的UDP网络发射机实现	admin 2024-12-26	01334	admin 2024-12-26 02:03
数字滤波的LabVIEW FPGA实现	admin 2024-10-26	01265	admin 2024-10-26 15:58
Spartan3通用OFDM调制器的VHDL实现	admin 2024-10-25	01602	admin 2024-10-25 01:09
应用VHDL设计的8b10b编码器，对串行数据的高速传输有用	admin 2024-2-9	04443	admin 2024-2-9 02:53
VHDL写的8B10B编码解码器的实现，在Xilinx平台通过验证	admin 2024-2-9	03451	admin 2024-2-9 02:51
灰度图象直方图均衡化，使用vivado的HLS来实现直方图的均衡化	admin 2024-2-8	03351	admin 2024-2-8 19:34
在Vivado上测试通过的FPGA抢答器	admin 2024-2-8	02455	admin 2024-2-8 17:35
使用Basys3开发板，采用等精度测频方法实现信号的测频并通过LCD1602显示	admin 2024-2-8	02341	admin 2024-2-8 03:38
16通道逻辑分析仪（Xilinx XC3S50AN-4TQ144C CY7C68013A-56PVXC）PCB图纸使用altium	admin 2024-2-8	02404	admin 2024-2-8 03:04
数字钟，数字电子技术课程设计常用内容，基于Basys3平台	admin 2024-2-7	02616	admin 2024-2-7 17:53
基于Basys3的简易数字钟，可用于Vivado开发环境入门，功能有计时和显示模块	admin 2024-2-7	02904	admin 2024-2-7 17:30
基于Xilinx FPGA的四旋翼简单控制系统ISE14.1工程文件	admin 2024-2-7	02453	admin 2024-2-7 04:15
Basys3的数字钟，可以显示00.00-59.59	admin 2024-2-5	02272	admin 2024-2-5 17:45
FPGA实现以太网UDP通信：基于Xilinx的AC701开发板编写的Verilog程序，使用FPGA实现以	admin 2023-12-1	02715	admin 2023-12-1 04:18
基于Vivado实现的具有数据选择器功能的ip	admin 2023-11-10	02551	admin 2023-11-10 00:39

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